面经-2023-哲库Zeku-数字芯片设计
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（大疆2020数字芯片）下列关于多bit数据跨时钟域的处理思路，错误的有（） A. 发送方给出数据，接收方用本地时钟同步两拍再使用； B. 发送方把数据写到异步fifo，接收方从异步fifo里读出； C. 对于连续变化的信号，...
（单选）实现同一功能的 Mealy 型同步时序电路比 Moore 型同步时序电路所需要的 ______。 A.状态数目更多 B....C....D....（1）Mealy型：输出信号不仅取决于当前状态，还取决于输入；...（2）Moore型：输出信号只取决于当前状态...
数字 IC 设计职位经典笔/面试题(建议收藏）
所有题目结果和解释由笔者给出，答案主观性较强，若有错误欢迎评论区指出，资料整理来自于“数字IC打工人”等数字IC相关公众号，牛客网等网站真题、网络笔试真题及面经抄录。
有5个成递增关系的32bit地址值，彼此之间的间隔大小不确定，可以把他们当成parameter来输入模块，现有一个32bit输入数据，要求用尽量少资源去的判断这个数处于哪2个地址之间（地址区间），并且输出区间号。...
数字IC笔试题
平头哥的手撕代码很有意思，平头哥技术终面手撕真题，题目描述如下：输入clk,每个时钟输入1比特的data_in,然后进来之后的序列是每次左移，也就是如果第一个时钟data_in=1,第二个时钟datain=0,第三个时钟data_in=1;...
在数字 IC 后端设计领域，后端工程师负责将芯片设计的前端部分转化为最终可生产的芯片。这本宝典通过提供丰富的面试题目和解析，帮助读者全面了解数字 IC 后端设计的知识和技巧。 本书首先对数字 IC 后端设计的基础...
【纯净题目版】2023-复睿微-数字芯片设计
IC修真院为大家整理了一些数字IC设计的笔试常见题目，大家快来领取吧~
本文来自芯社区，谢谢。 1：什么是同步逻辑和异步逻辑？ 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 同步时序逻辑电路的特点：各触发器的时钟端全部连接在一起，...
转自知乎答主ictown_数字IC设计工程师笔试面试经典100题-有答案-陈恩 1：什么是同步逻辑和异步逻辑？（汉王） 同步逻辑是时钟之间有固定的因果关系。异步逻辑是各时钟之间没有固定的因果关系。 同步时序逻辑电路的...
CMOS数字集成电路 面试中可能会遇到的知识点 建立保持时间 / 亚稳态如何产生及解决 / 竞争冒险产生及解决 /低功耗设计 /时钟歪斜和抖动 及产生原因 / 同步异步的概念 / 同步复位异步复位 / 异步复位...
目录 1. 组合逻辑中插入寄存器（插入流水线） 2. 寄存器平衡（重定时Retiming） 3. 操作符平衡（加法树、乘法树） 4. 消除代码优先级（case代替if…else） 5. 逻辑复制 ...关键路径通常是指同步逻辑电路中，组合...
input delay：时钟触发后信号信号到达输入端口前经过的延迟。output delay：输出端口输出信号后到下一个触发器采样前信号的传输延迟。
数字ic设计自学ing
标签： 数字ic
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